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发明名称 DURCH EIN EINZIGES TAKTSIGNAL BETAETIGTER BAUSTEIN FUER SEQUENZIELLE LOGIK IN CMOS-TECHNOLOGIE.
摘要
申请公布号 DE209829(T1) 申请公布日期 1989.06.01
申请号 DE19860109657T 申请日期 1986.07.14
申请人 CSELT-CENTRO STUDI E LABORATORI TELECOMUNICAZIONI S.P.A., TURIN/TORINO, IT 发明人 FASSINO, MARIO, TORINO, IT;GHISIO, GUIDO, IVREA TORINO, IT
分类号 H03K3/356;H03K3/3562;(IPC1-7):H03K3/356 主分类号 H03K3/356
代理机构 代理人
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