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Bei einem solchen Multiprozessor, bei welchem der gemeinsame Speicher (M) oder einer der Cache-Speicher (C1, C2) Eigner einer durch ihre Adresse bestimmten Variablen sein können und bei welchem stets nur der Ei gner einer Variablen diese auf eine Leseanforderung hin auf den Bus (B) liefert, wird durch die vorliegende Erfindung das Konzept der Eignerschaft im Hinblick auf seine Implementierung mit an sich dafür nicht vorgesehenen Standardbussen sowie im Hinblick auf grösstmöglichste Effizienz weiterentwickelt.
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