Method of demodulating an input signal phase-modulated by a binary bit sequence, and circuit arrangement therefor.

摘要

Zur Demodulation eines sog. RDS-Signals wird dieses in einem sich fortlaufend wiederholenden Abtastzyklus jeweils viermal abgetastet, wobei die Abtastzeitpunkte jedes Abtastzyklus mittels einer mit dem RDS-Signal synchronisierten Rechteckimpulsfolge so festgelegt sind, daß die Abtastwerte um jeweils ein Viertel der Signalperiode zueinander phasenverschoben sind und der erste Abtastwert in etwa in einer Nullstelle des RDS-Signals liegt. Die aufeinanderfolgenden geradzahligen Abtastwerte aller Abtastzyklen werden miteinander verglichen. Bei Ungleichheit wird der dazwischenliegende ungeradzahlige Abtastwert mit einem der beiden geradzahligen Abtastwerte auf Parität geprüft. Die Prüfergebnisse werden entsprechend ihrer Parität addiert bzw. subtrahiert und aus der Summe wird ein Synchronisiersignal für die Rechteckimpulsfolge abgeleitet. Bei Gleichheit der verglichenen geradzahligen Abtastwerte wird festgestellt, ob diese einem einzigen Abtastzyklus oder aufeinanderfolgenden Abtastzyklen angehören. Wenn die Häufigkeit der die Abtastzyklusidentität ausweisenden Prüfergebnisse einen Vorgabewert überschreitet, wird eine Phasenverschiebung der Rechteckimpulsfolge um 180° durchgeführt. Die im RDS-Signal enthaltene Bitfolge der RDS-Information wird aus den geradzahligen Abtastwerten zurückgewonnen.