发明名称 |
CURRENT LIMIT TECHNIQUE FOR MULTIPLE-EMITTER VERTICAL POWER TRANSISTOR. |
摘要 |
Circuits (18, 20, 22, 24) permettant de limiter le courrant de sortie d'un transistor PNP à substrat de puissance (2...n) comprenant une pluralité d'émetteurs (p. ex. 260). Une résistance (8) est placée entre une partie de la pluralité d'émetteurs (p. ex. 8) et une source de tension d'alimentation. Lorsque le dispositif de puissance est mis sous tension, le courant traverse la résistance provoquant une chute de tension entre ses bornes. Cette chute de tension est contrôlée et lorsqu'elle atteint un certain niveau, un signal de commande est produit de manière à limiter finalement le courant conduit du transistor de puissance. |
申请公布号 |
EP0172175(A1) |
申请公布日期 |
1986.02.26 |
申请号 |
EP19850900382 |
申请日期 |
1984.12.07 |
申请人 |
MOTOROLA, INC. |
发明人 |
BYNUM, BYRON, G.;CAVE, DAVID, L. |
分类号 |
H03K17/082;(IPC1-7):H03K17/08 |
主分类号 |
H03K17/082 |
代理机构 |
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代理人 |
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主权项 |
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地址 |
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