COMPUTER PROCESSOR CONTROLLER.

摘要

Contrôleur de processeur (40) à utiliser dans un ordinateur insensible aux défaillances (Fig. 1) possédant des processeurs redondants (30 et 32) et exécutant des programmes indentiques. Malgré le fait que les programmes sont identiques, les processeurs exécutent les instructions à des vitesses différentes puisque les processeurs ne sont par exemple pas autorisés à accéder à leur bus commun (36) au même moment effectif. Le contrôleur reçoit des signaux d'interruption (42) destinés aux processeurs et les présente aux processeurs respectifs à la même position dans le programme. Le contrôleur surveille la position de chaque processeur pendant son exécution du programme, d'une manière typique en comptant les signaux d'échantillonnage d'adresses. Dans un mode de réalisation, le processeur le plus avancé dans le programme est arrêté par le contrôleur jusqu'à ce qu'il soit rattrapé par le processeur en retard. A ce moment là, les interruptions sont présentées simultanément aux processeurs qui sont libérés. Dans un second mode de réalisation, l'interruption est transmise immédiatement aux processeurs en avance et la situation du processeur dans le programme est stockée. Le processeur en avance utilise ensuite l'interruption et poursuit le programme. Lorsque le processeur en retard arrive à la même position dans le programme, il reçoit également notification de l'interruption. Ce contrôleur permet l'utilisation de programmes d'applications disponibles commercialement sans modification spéciale.