Buffer memory control circuit.

摘要

Un train d'impulsions provenant du dispositif (10) est appliqué simultanément à un détecteur de transitions (12) et un compteur (14) engendrant un mot binaire dont la valeur est fonction de la largeur de chaque impulsion. Les mots binaires ainsi obtenus sont appliqués en parallèle à un circuit logique de sélection (18) délivrant un signal chaque fois qu'un nombre prédéterminé de mots successifs satisfait à des tests logiques grossiers. Ce signal est ajouté au mot présent sur le câble (16) et le mot ainsi obtenu est appliqué aux circuits de commande (20) et (22) permettant de les orienter vers l'une ou l'autre des mémoires tampons (24) et (26) sans le contrôle d'un circuit de sélection (28) qui envoie également un signal au processeur (30) lorsque l'une des mémoires (24) ou (26) est remplie.