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发明名称
PIPELINED ANALOG DIGITAL CONVERTOR
摘要
본 발명에 따른 파이프라인 아날로그 디지털 변환기는 디지털 출력의 정정구간과 비정정구간을 구분하기 위한 논리회로의 복잡도를 개선하는 디지털 정정회로를 구비한다. 본 발명에 따른 파이프라인 아날로그 디지털 변환기는, 데이터 에러 정정시 이진 쉬프트시켜 논리 교정 동작을 간단하게 수행함으로써, 해상도가 증가하더라도 논리회로의 복잡도를 낮추고 구현 면적을 감소시킬 수 있다.
申请公布号
KR101685011(B1)
申请公布日期
2016.12.14
申请号
KR20100125775
申请日期
2010.12.09
申请人
한국전자통신연구원
发明人
남재원;전영득;조영균;권종기
分类号
H03M1/12;H03M1/06;H03M1/16;H03M13/00
主分类号
H03M1/12
代理机构
代理人
主权项
地址
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