发明名称 PROFIBUS总线智能诊断记录仪及方法
摘要 PROFIBUS总线智能诊断记录仪及方法,该记录仪包括外部接线接口、电源模块、以太网接口模块、485收发模块、微处理器、FLASH存储器、系统内存以及板级总线;板级总线包括26条地址总线A0~A25、16条数据总线D0~D15以及两条地线GND和485GND;本发明还提供该记录仪的智能诊断方法,本发明记录仪结构简单,能够记录并分析PROFIBUS总线的数据帧,并对PROFIBUS总线的运行状态、通信故障、从站设备进行智能诊断。
申请公布号 CN104615128B 申请公布日期 2017.03.15
申请号 CN201510079195.8 申请日期 2015.02.13
申请人 西安热工研究院有限公司 发明人 李晓博;高海东;刘茜;王春利
分类号 G05B23/02(2006.01)I 主分类号 G05B23/02(2006.01)I
代理机构 西安智大知识产权代理事务所 61215 代理人 何会侠
主权项 PROFIBUS总线智能诊断记录仪,其特征在于:包括外部接线接口(E1)、电源模块(E2)、以太网接口模块(E3)、485收发模块(E4)、微处理器(E5)、FLASH存储器(E6)、系统内存(E7)以及板级总线;所述板级总线包括26条地址总线A0~A25、16条数据总线D0~D15以及两条地线GND和485GND;所述外部接线接口(E1)包括+5V电源接线柱、地线GND接线柱、485+接线柱和485‑接线柱,485+接线柱和485‑接线柱提供外部485输入信号的接线接口;所述电源模块(E2)通过外部接线接口(E1)引入外部+5V直流电源,并向以太网接口模块(E3)、485收发模块(E4)、微处理器(E5)、FLASH存储器(E6)和系统内存(E7)提供+5V、+3.3V电源输出,以太网接口模块(E3)、485收发模块(E4)、微处理器(E5)、FLASH存储器(E6)、系统内存(E7)根据本模块电源要求选择接入的供电电压;所述以太网接口模块(E3)采用DM9000A,其管脚SD0~SD15依次接入板级总线的数据总线D0~D15,管脚RESET连接微处理器(E5)管脚120,管脚CMD连接微处理器(E5)管脚135,管脚INT连接微处理器(E5)管脚69;所述485收发模块(E4)包括三个高速光耦隔离器HCPL0600和一个型号为SN75LBC184P的485总线收发器(U38),所述三个高速光耦隔离器HCPL0600分别为第一高速光耦隔离器HCPL0600(H3)、第二高速光耦隔离器HCPL0600(H4)和第三高速光耦隔离器HCPL0600(H5),其中第一高速光耦隔离器HCPL0600(H3)的管脚6连接微处理器(E5)的管脚103,第二高速光耦隔离器HCPL0600(H4)的管脚3连接微处理器(E5)的管脚102,第三高速光耦隔离器HCPL0600(H5)的管脚3连接微处理器(E5)的管脚104,第一高速光耦隔离器HCPL0600(H3)的管脚3连接485总线收发器(U38)的管脚R,第二高速光耦隔离器HCPL0600(H4)的管脚6连接485总线收发器(U38)的管脚D,第三高速光耦隔离器HCPL0600(H5)的管脚6连接485总线收发器(U38)的管脚RE和DE,485总线收发器(U38)的管脚A和B分别连接外部485总线的A线和B线;所述微处理器(E5)采用AT91RM9200,其管脚D0~D15依次接入板级总线的数据总线D0~D15,管脚A0~A22依次接入地址总线A0~A22;所述FLASH存储器(E6)采用第一片E28F128J3A‑150(U9)和第二片E28F128J3A‑150(U10)并用的方式,每片容量为16M×16位,微处理器(E5)的管脚166作为FLASH片选信号FLASH_NCS0,接入38译码器(U11)的管脚<img file="FDA0001187334650000021.GIF" wi="130" he="66" />微处理器(E5)的地址线A25接入38译码器(U11)的管脚A,38译码器(U11)的管脚<img file="FDA0001187334650000022.GIF" wi="75" he="63" />连接第一片E28F128J3A‑150(U9)的CE0,38译码器(U11)的管脚<img file="FDA0001187334650000023.GIF" wi="74" he="63" />连接第二片E28F128J3A‑150(U10)的管脚CE0,第一片E28F128J3A‑150(U9)和第二片E28F128J3A‑150(U10)管脚D0~D15依次接入数据总线D0~D15,管脚A0~A24依次接入地址总线A0~A24;所述系统内存(E7)采用同步动态随机存储器MT48LC8M16A2,其管脚CKE连接微处理器(E5)的管脚175,管脚CLK连接微处理器(E5)管脚174,管脚<img file="FDA0001187334650000024.GIF" wi="77" he="63" />连接微处理器(E5)管脚167,管脚<img file="FDA0001187334650000025.GIF" wi="94" he="63" />连接微处理器(E5)管脚178,管脚<img file="FDA0001187334650000026.GIF" wi="105" he="63" />连接微处理器(E5)管脚177,管脚<img file="FDA0001187334650000027.GIF" wi="115" he="63" />连接微处理器(E5)管脚176,管脚DQ0~DQ15依次接入数据总线D0~D15,管脚A0~A11依次接入地址总线A0~A11。
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