发明名称 一种基于FinFET器件绝热PAL-2N结构型JK触发器
摘要 本发明公开了一种基于FinFET器件绝热PAL‑2N结构型JK触发器,包括第一P型FinFET管、第二P型FinFET管、第三P型FinFET管、第四P型FinFET管、第一N型FinFET管、第二N型FinFET管、第三N型FinFET管、第四N型FinFET管、第五N型FinFET管、第六N型FinFET管、第七N型FinFET管、第八N型FinFET管、第九N型FinFET管、第十N型FinFET管和第十一N型FinFET管;优点是本发明的绝热PAL‑2N结构型JK触发器在不影响电路性能的情况下,减少了FinFET管的数量,电路面积显著减少、延时、功耗和功耗延时积显著降低。
申请公布号 CN105978534A 申请公布日期 2016.09.28
申请号 CN201610260841.5 申请日期 2016.04.22
申请人 宁波大学 发明人 胡建平;余峰
分类号 H03K3/012(2006.01)I 主分类号 H03K3/012(2006.01)I
代理机构 宁波奥圣专利代理事务所(普通合伙) 33226 代理人 方小惠
主权项 一种基于FinFET器件绝热PAL‑2N结构型JK触发器,其特征在于包括第一P型FinFET管、第二P型FinFET管、第三P型FinFET管、第四P型FinFET管、第一N型FinFET管、第二N型FinFET管、第三N型FinFET管、第四N型FinFET管、第五N型FinFET管、第六N型FinFET管、第七N型FinFET管、第八N型FinFET管、第九N型FinFET管、第十N型FinFET管和第十一N型FinFET管;所述的第一P型FinFET管的源极、所述的第二P型FinFET管的源极、所述的第三N型FinFET管的源极、所述的第四N型FinFET管的源极、所述的第五N型FinFET管的源极、所述的第六N型FinFET管的源极和所述的第七N型FinFET管的源极连接且其连接端为所述的绝热PAL‑2N结构型JK触发器的第一时钟信号输入端,所述的绝热PAL‑2N结构型JK触发器的第一时钟信号输入端接入幅值电平对应逻辑1的第一时钟信号,所述的第三P型FinFET管的源极、所述的第四P型FinFET管的源极、所述的第十N型FinFET管的源极和所述的第十一N型FinFET管的源极连接且其连接端为所述的绝热PAL‑2N结构型JK触发器的第二时钟信号输入端,所述的绝热PAL‑2N结构型JK触发器的第二时钟信号输入端接入幅值电平对应逻辑1的第二时钟信号,所述的第二时钟信号和所述的第一时钟信号的相位相差180度,所述的第一P型FinFET管的漏极、所述的第二P型FinFET管的前栅、所述的第二P型FinFET管的背栅、所述的第一N型FinFET管的漏极、所述的第二N型FinFET管的前栅、所述的第二N型FinFET管的背栅、所述的第三N型FinFET管的漏极、所述的第四N型FinFET管的漏极、所述的第十N型FinFET管的前栅和所述的第十N型FinFET管的背栅连接且其连接端为所述的绝热PAL‑2N结构型JK触发器的第一输入端,所述的第二P型FinFET管的漏极、所述的第一P型FinFET管的前栅、所述的第一P型FinFET管的背栅、所述的第二N型FinFET管的漏极、所述的第五N型FinFET管的漏极、所述的第六N型FinFET管的漏极、所述的第七N型FinFET管的漏极、所述的第一N型FinFET管的前栅、所述的第一N型FinFET管的背栅、所述的第十一N型FinFET管的前栅和所述的第十一N型FinFET管的背栅连接,所述的第三P型FinFET管的漏极、所述的第四P型FinFET管的前栅、所述的第四P型FinFET管的背栅、所述的第十N型FinFET管的漏极、所述的第九N型FinFET管的前栅、所述的第九N型FinFET管的背栅、所述的第八N型FinFET管的漏极、所述的第四N型FinFET管的背栅和所述的第六N型FinFET管的背栅连接,所述的第四P型FinFET管的漏极、所述的第三P型FinFET管的前栅、所述的第三P型FinFET管的背栅、所述的第十一N型FinFET管的漏极、所述的第八N型FinFET管的前栅、所述的第八N型FinFET管的背栅、所述的第九N型FinFET管的漏极、所述的第三N型FinFET管的背栅和所述的第七N型FinFET管的背栅连接,所述的第一N型FinFET管的源极、所述的第二N型FinFET管的源极、所述的第八N型FinFET管的源极和所述的第九N型FinFET管的源极接地,所述的第三N型FinFET管的前栅为所述的绝热PAL‑2N结构型JK触发器的第一输入端,所述的第五N型FinFET管的前栅和所述的第六N型FinFET管的前栅连接且其连接端为所述的绝热PAL‑2N结构型JK触发器的第二输入端,所述的第四N型FinFET管的前栅为所述的绝热PAL‑2N结构型JK触发器的第二反相输入端,所述的第五N型FinFET管的背栅和所述的第七N型FinFET管的前栅连接且其连接端为所述的绝热PAL‑2N结构型JK触发器的第一反相输入端;所述的第一P型FinFET管、所述的第二P型FinFET管、所述的第三P型FinFET管和所述的第四P型FinFET管的鳍的个数为2,所述的第一N型FinFET管、所述的第二N型FinFET管、所述的第三N型FinFET管、所述的第四N型FinFET管、所述的第五N型FinFET管、所述的第六N型FinFET管、所述的第七N型FinFET管、所述的第八N型FinFET管、所述的第九N型FinFET管、所述的第十N型FinFET管和所述的第十一N型FinFET管的鳍的个数为1。
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