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发明名称
积体电路及于积体电路中建立扫描测试架构之方法;INTEGRATED CIRCUIT AND METHOD FOR ESTABLISHING SCAN TEST ARCHITECTURE IN INTEGRATED CIRCUIT
摘要
一种积体电路及于其中建立扫描测试架构之方法。积体电路包括复数电路模组。每一电路模组包括一时脉控制单元、一第一管线单元、一串列式压缩扫描电路与一第二管线单元。时脉控制单元根据一测试时脉产生一第一扫描时脉。第一管线单元根据第一扫描时脉将一测试输入信号转换成一第一资料。串列式压缩扫描电路根据第一资料和测试时脉而产生一第二资料。第二管线单元根据扫描时脉将第二资料转换成一测试输出信号。上述电路模组之每一者之第一扫描时脉系独立于其他电路模组之第一扫描时脉,从而可降低时序分析与调整的困难度和成本。
申请公布号
TW201537198
申请公布日期
2015.10.01
申请号
TW103117732
申请日期
2014.05.21
申请人
联发科技(新加坡)私人有限公司 MEDIATEK SINGAPORE PTE. LTD.
发明人
任建国 REN, JIANGUO;戴冲 DAI, CHONG;高峰国 GAO, FENGGUO;黄上宾 HUANG, SHANG BIN;薛文皓 HSUEH, WEN HAO
分类号
G01R31/3181(2006.01);G01R31/26(2014.01);H01L21/66(2006.01)
主分类号
G01R31/3181(2006.01)
代理机构
代理人
洪澄文颜锦顺
主权项
地址
新加坡 SG
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