发明名称 用于提升走线资源的集成电路结构及方法
摘要 本发明公开了一种用于提升走线资源的集成电路结构及方法,该方法包括:步骤A:提供包括有若干单元块的单元库,单元块具有沿至少两个方向延伸的单元块区域,单元块区域的底层包括具有有源区域、扩散区域及栅极带区域的MOS管区域;的单元块区域的导体层包括若干导体、电源线、地线;步骤B:于版图中设定第一区域、第二区域,并于第一方向布设单元块于第一区域,于第二方向布设单元块于第二区域,其中,第一、第二区域分别设置有结构上相互对应的电性连接部,进行匹配的电性连接。通过本发明的技术方案,可以增加20%左右的走线资源,同时也可以增加电源线和地线连接的灵活性。
申请公布号 CN103956332A 申请公布日期 2014.07.30
申请号 CN201410187053.9 申请日期 2014.05.05
申请人 格科微电子(上海)有限公司 发明人 赵立新;俞大立;柳雅琳;庄群峰
分类号 H01L21/768(2006.01)I;H01L27/02(2006.01)I 主分类号 H01L21/768(2006.01)I
代理机构 北京市金杜律师事务所 11256 代理人 郑立柱
主权项 一种基于单元库的集成电路设计方法,其特征在于,包括如下步骤:A:提供包括有若干单元块的单元库,所述单元块具有沿至少两个方向延伸的单元块区域,所述单元块区域的底层包括具有有源区域、扩散区域及栅极带区域的MOS管区域;所述的单元块区域的导体层包括若干导体、电源线、地线;B:于版图中设定第一区域、第二区域,并于第一方向布设所述单元块于所述第一区域,于第二方向布设所述单元块于所述第二区域,其中,所述第一、第二区域分别设置有结构上相互对应的电性连接部,进行匹配的电性连接。
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