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发明名称
线路基板制程及线路基板结构
摘要
一种线路基板制程。首先,提供具有接垫的基材及介电叠层。介电叠层配置于基材而覆盖接垫。介电叠层包括第一介电层、第二介电层及位于第一与第二介电层之间的第三介电层。第三介电层的蚀刻速率大于第一介电层及第二介电层的蚀刻速率。接着,形成对位于接垫的开口于介电叠层。湿蚀刻介电叠层,以移除第三介电层围绕开口的部分,而形成空隙于第一介电层围绕开口的部分与第二介电层围绕开口的部分之间。进行镀膜制程以分别形成被空隙隔离的第一镀层及第二镀层于介电叠层及接垫。
申请公布号
TWI396482
申请公布日期
2013.05.11
申请号
TW099125377
申请日期
2010.07.30
申请人
光明电子股份有限公司
发明人
陈国祚
分类号
H05K3/00;H05K1/02
主分类号
H05K3/00
代理机构
代理人
詹铭文 台北市中正区罗斯福路2段100号7楼之1;叶璟宗 台北市中正区罗斯福路2段100号7楼之1
主权项
地址
新竹市食品路27号2楼之7 TW 2F.-7, NO. 27, SHIPIN RD., EAST DIST., HSINCHU CITY 300, TAIWAN (R. O. C.)
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