发明名称 |
Verfahren und Vorrichtung zur Koordination von Speicheroperationen zwischen unterschiedlich angeordneten Speicherkomponenten |
摘要 |
A specific address and control bus, and a data bus (108), are connected to a memory controller (102) and a memory module (103). The data bus using differential signaling, has symbol time lesser than specific address and control bus symbol time. |
申请公布号 |
DE60235050(D1) |
申请公布日期 |
2010.02.25 |
申请号 |
DE2002635050 |
申请日期 |
2002.04.23 |
申请人 |
RAMBUS INC. |
发明人 |
WARE, FREDERICK A.;TSERN, ELY K.;PEREGO, RICHARD E.;HAMPEL, CRAIG E. |
分类号 |
G06F12/00;G06F13/42;G06F13/16;G06F13/40;G11C8/00;G11C11/401;G11C29/00;G11C29/02 |
主分类号 |
G06F12/00 |
代理机构 |
|
代理人 |
|
主权项 |
|
地址 |
|