发明名称 决定滙流排上传送资料所需滙流排连接数目之方法及资料传送/接收方法
摘要 一种混合平行/串列汇流排介面,此者具有一资料区块解多工装置。该资料区块解多工装置具有一输入,此者经组态设定以接收一资料区块,并将该资料区块解多工成复数个细块。对于各个细块,一平行转串列转换器可将该细块转化成串列资料。一线路可传送各个细块的串列资料。一串列转平行转换器可转换各细块的串列资料以复原该细块。资料区块重建装置可将各复原细块合并成该资料区块。
申请公布号 TWI272499 申请公布日期 2007.02.01
申请号 TW092127354 申请日期 2002.11.21
申请人 内数位科技公司 发明人 约瑟 葛瑞丹;艾佛瑞 史达福利;堤摩西A. 亚瑟尼司
分类号 G06F13/40(2006.01) 主分类号 G06F13/40(2006.01)
代理机构 代理人 蔡清福 台北市中山区中山北路3段27号13楼
主权项 1.一种用以传送资料之方法,其中该方法包含: 提供一资料区块; 将该资料区块解多工成复数个细块,各个细块具有 复数个位元; 对于各个细块: 将该细块转换成串列资料; 提供一线路,并在该线路上传送该细块串列资料; 将该细块串列资料转换成平行资料,俾复原该细块 ;及 将各复原细块合并成该资料区块。 2.如申请专利范围第1项之方法,其中在资料区块内 的位元数目为N,线路数目为i,而1<i<N。 3.如申请专利范围第1项之方法,其中在一细块内的 位元数目为四,线路数目为二。 4.一种用以透过连接一第一节点至一第二节点之 介面来传送资料区块之方法,其中该方法包含: 将该资料区块解多工成m组n个位元; 对该m组增附一开始位元,该m个开始位元可共集地 代表一特定数学函数与目的地; 在个别线路上,从该第一节点传送该m组的每一个; 在该第二节点处接收每个该传送的该m组;及 根据该m个开始位元来利用所接收的该m组。 5.如申请专利范围第4项之方法,其中该m个开始位 元至少其一会为1状态,且当该介面并未传送资料 时,所有的个别线路的该开始位元会为0状态。 6.如申请专利范围第4项之方法,其中该m个开始位 元代表开始一资料传送作业。 7.如申请专利范围第4项之方法,其中该m个开始位 元共集地代表一特定数学函数而非一目的地。 8.如申请专利范围第4项之方法,其中该m个开始位 元共集地代表一包括一相对增加、一相对减少及 一绝对値函数。 9.如申请专利范围第4项之方法,其中该m个开始位 元共集地代表一特定目的地而非一数学函数。 10.如申请专利范围第9项之方法,其中该m个开始位 元共集地代表包括一RX及TX增益控制器。 11.如申请专利范围第4项之方法,其中该m个开始位 元共集地代表一特定数学函数及一特定目的地。 12.一种用以决定滙流排上传送资料所需滙流排连 接数目之方法,该等区块资料的各区块具有N个位 元,该方法包含: 决定为传送该等资料区块而可承允的最大延迟; 决定依该最大延迟,为传送该等资料区块而所需之 连线最小数目;及 决定i値,而i系至少等于该所需连线之最小数目的 数値。 13.如申请专利范围第12项之方法,其中该i条滙流排 连线会对应于一晶片上的i个接脚。 14.如申请专利范围第13项之方法,其中该1<i<N。 15.一种传送/接收之方法,其中包含: 藉一增益控制(GC)控制器产生一资料区块,该资料 区块具有n个表示一增益値的位元; 经i条线路,将该资料区块从该GC控制器传送到一GC, 在此1<i<n; 于该GC处接收该资料区块;及 利用该资料区块的增益値来调整该GC增益。 16.如申请专利范围第15项之方法,其中进一步包含: 在传送该资料之前,先将该资料区块解多工成复数 个细块,各细块系为于该i条线路之不同线路上传 送;及 在接收该资料区块之后,将各细块合并成该资料区 块。 17.如申请专利范围第16项之方法,其中被增附至各 细块者系一开始位元。 18.如申请专利范围第17项之方法,其中该开始位元 可表述一数学函数。 19.如申请专利范围第18项之方法,其中由该开始位 元所表述的数学函数包括一相对增加、一相对减 少及一绝对値函数。 20.如申请专利范围第16项之方法,其中该GC包括一RX GC及一TX GC,而该等开始位元说明该区块是否被送 到RX GC或TX GC。 图式简单说明: 图1系RX与TX GC和GC控制器图式说明。 图2系一混合平行/串列滙流排介面区块图。 图3系利用混合平行/串列滙流排介面之资料区块 传送作业流程图。 图4说明将一区块转成最显着及最小显着细块之解 多工作业。 图5说明利用资料交错处理对一区块进行解多工作 业。 图6系一双向混合平行/串列滙流排介面之区块图 。 图7系一双向线路实作图式。 图8系开始位元之计时图。 图9系一函数可控制性之混合平行/串列滙流排介 面的区块图。 图10系一函数可控制性之混合平行/串列滙流排介 面的开始位元计时图。 图11系表示各项函数之开始位元实作列表。 图12系目的地控制混合平行/串列滙流排介面之区 块图。 图13系表示各项目的地之开始位元实作列表。 图14系表示各项目的地/函数之开始位元实作列表 。 图15系目的地/函数控制混合平行/串列滙流排介面 之区块图。 图16系表示各项目的地/函数之开始位元流程图。 图17系正及负时脉边缘之混合平行/串列滙流排介 面区块图。 图18系正及负时脉边缘之混合平行/串列滙流排介 面计时图。 图19系一2线式GC/GC控制器滙流排区块图。 图20系一3线式GC/GC控制器滙流排区块图。
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