发明名称 loop travado por fase digital
摘要 "LOOP TRAVADO POR FASE DIGITAL". Um PLL digital inclui um PFD adaptativo, um filtro de loop adaptativo, um iDAC, um ICO e um divisor. O PFD adaptativo recebe um sinal de referência e um sinal de realimentação, determina erro de fase entre os dois sinais, e provê um valor PFD para cada período de comparação de fase. A magnitude do valor PFD é ajustada para se obter rápida aquisição de freqüência e jitter reduzido. O filtro de loop adaptativo atualiza sua saída sempre que um valor PFD for recebido, amplia a largura de banda de loop PFL se um erro de fase grande for detectado, e estreita a largura de banda de loop se um erro de fase médio pequeno for detectado. O iDAC que pode ser implementado com ambas as fontes de corrente, guiada e de extremidade única, converte a saída de filtro de loop em corrente analógica. O ICO provê um sinal de oscilador tendo uma fase determinada pela saída iDAC. O divisor divide o sinal de oscilador por um fator de N e provê o sinal de realimentação.
申请公布号 BRPI0409107(A) 申请公布日期 2006.05.02
申请号 BR2004PI09107 申请日期 2004.04.08
申请人 QUALCOMM INCORPORATED 发明人 AMR FAHIM
分类号 H03D13/00;H03L7/085;H03L7/093;H03L7/099;H03L7/10;(IPC1-7):H03L7/00 主分类号 H03D13/00
代理机构 代理人
主权项
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