发明名称 GENERADOR DE IMPULSOS.
摘要 UN GENERADOR DE PULSO PARA GENERAR UN PULSO DE SALIDA QUE SE SINCRONIZA A UN PULSO DE RELOJ INTERNO QUE INCLUYE UN CIRCUITO DETECTOR DE PESTILLO (24) , UN PESTILLO MAESTRO (12), UN PESTILLO DE RELOJ (14), UN PRIMER MEDIO -PESTILLO DE RELOJ (16), Y UN CIRCUITO LOGICO DE SALIDA (18). EL PESTILLO DETECTOR (24) RESPONDE SOLO AL BORDE POSITIVO DEL PULSO SINCRONOMO DE UN ANCHO VARIANTE PARA GENERAR UNA SEÑAL DE DISPARO QUE SE CIERRA A UN NIVEL LOGICO BAJO. EL PESTILLO MAESTRO (12) RESPONDE A LA SEÑAL DE DISPARO PARA GENERAR UNA PRIMERA SEÑAL CERRADA QUE SE CIERRA A UN NIVEL LOGICO ALTO. EL MEDIO DE PESTILLO DE RELOJ (14) RESPONDE A LA PRIMERA SEÑAL CERRADA Y A UNA PRIMERA SEÑAL DE PULSO DE RELOJ INTERNO PARA GENERAR UNA SEGUNDA SEÑAL CERRADA QUE SE CIERRA A UN NIVEL LOGICO ALTO. EL PRIMER MEDIO-PESTILLO DE RELOJ (16) RESPONDE A LA SEGUNDA SEÑAL CERRADA Y A UNA SEGUNDA SEÑAL DE PULSO DE RELOJ INTERNO PARA GENERAR UNA SEÑAL DE CONTROL. EL CIRCUITO LOGICO DE SALIDA (18) RESPONDE A LA PRIMERA SEÑAL DE PULSO DE RELOJ INTERNO Y A LA SEÑAL DE CONTROL PARA GENERAR UNA SEÑAL DE PULSO DE SALIDA QUE SE SINCRONIZA A LA PRIMERA SEÑAL DE PULSO DE RELOJ INTERNO CUANDO LA SEÑAL DE CONTROL ESTA EN EL NIVEL LOGICO BAJO. SE PROPORCIONA UN CIRCUITO DESCARGADOR (19) Y RESPONDE A LA SEÑAL DE CONTROL Y A LA PRIMERA SEÑAL DE PULSO DE RELOJ INTERNO PARA GENERAR UNA SEÑAL DE DESCARGA QUE REAJUSTA LA PRIMERA SEÑAL CERRADA A UN NIVEL LOGICO BAJO EN LA SALIDA DEL PESTILLO MAESTRO.
申请公布号 ES2103340(T3) 申请公布日期 1997.09.16
申请号 ES19920301898T 申请日期 1992.03.05
申请人 ADVANCED MICRO DEVICES, INC. 发明人 HATTANGADI, RAJIV M.
分类号 G06F1/06;G06F1/12;H03K5/05;H03K5/135;H03L7/06;(IPC1-7):H03K5/135;H03K3/033 主分类号 G06F1/06
代理机构 代理人
主权项
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