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经营范围
发明名称
METHOD FOR PREPARING LOGICAL CIRCUIT DIAGRAM
摘要
申请公布号
JPH07134726(A)
申请公布日期
1995.05.23
申请号
JP19930279744
申请日期
1993.11.09
申请人
MATSUSHITA ELECTRIC IND CO LTD
发明人
YAMAMOTO TAKAO
分类号
G06F17/50;(IPC1-7):G06F17/50
主分类号
G06F17/50
代理机构
代理人
主权项
地址
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