| 摘要 |
Afin de verrouiller l'utilisation d'informations partagées dans un système multiprocesseur (100) ayant deux processeurs (101, 111) opérant de façon indépendante et asynchrone dont les unités de mémoire centrale (101, 112) reproduisent mutuellement leur contenu, un processeur doit provoquer l'exécution d'une opération atomique de lecture-modification-écriture (LME) par un sémaphore dans les unités de mémoire centrale reproduites des deux processeurs. Afin de régler correctement l'ordre d'exécution de telles opérations multiples de LME, des arbitres (106, 116) de bus des systèmes (105, 115) des deux processeurs sont mis en communication par un canal interarbitre (121). L'arbitre d'un processeur émetteur qui souhaite exécuter une opération LME le notifie à l'arbitre de l'autre processeur par le canal interarbitre. Des tentatives simultanées de notification par les deux arbitres sont tranchées en faveur de l'un d'eux désigné comme étant le maître. L'arbitre notificateur empêche son processeur d'exécuter une autre opération de LME jusqu'à ce que la première opération de LME ait été achevée, mais permet à d'autres opérations de se poursuivre normalement. L'arbitre ayant reçu la notification empêche son processeur d'exécuter une autre opération de LME jusqu'à ce que la première opération de LME ait été transferée par des connexions (107, 117) entre les processeurs et par un bus (120) du processeur émetteur au processeur de l'arbitre ayant reçu la notification, et y ait eté exécutée, mais permet à d'autres opérations de se poursuivre normalement. Des opérations multiples de LME sont ainsi exécutées par les deux processeurs dans le même ordre, de façon asynchrone et sans affecter l'exécution. |
