发明名称 |
SHIFT REGISTER |
摘要 |
Un registre a décalage (60) peut modifier une longueur effective d'un bit sans introduire aucun changement dans la structure interne du registre à décalage (60). A cet effet, un générateur de signaux d'horloge de transfert (71) est prévu pour envoyer un signal d'horloge de transfert au registre à décalage (60) ce qui a pour conséquence de modifier les données d'horloge obtenues de l'horloge de transfert et l'état d'entrée du registre à décalage. Ce registre à décalage peut être appliqué à une mémoire d'une structure SPS ou autre. |
申请公布号 |
WO8302678(A1) |
申请公布日期 |
1983.08.04 |
申请号 |
WO1983JP00020 |
申请日期 |
1983.01.24 |
申请人 |
SONY CORPORATION |
发明人 |
SATO, MAKI;NARABU, TADAKUNI;HASHIMOTO, TAKEO |
分类号 |
G11C27/04;G11C19/28;G11C19/38;G11C27/00;H01L21/339;H01L29/762;H01L29/78;(IPC1-7):11C19/28;11C27/00 |
主分类号 |
G11C27/04 |
代理机构 |
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代理人 |
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主权项 |
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地址 |
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