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<P>L'invention concerne les ordinateurs travaillant en virgule flottante </P><P>Le processeur de l'invention comprend en particulier un multiplicateur en virgule flottante 36 comportant trois étages en cascade, un additionneur en virgule flottante 34 comportant deux étages en cascade, des mémoires 18, 20, 22, 24 et des lignes bus qui interconnectent les différents élements. La structure utilisée permet de fournir un résultant de calcul à chaque cycle d'horloge, et de changer la configuration sans perdre un cycle d'horloge. </P><P> Application aux ordinateurs de grande puissance.</P>
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