发明名称 忆容器的实现电路
摘要 本实用新型公开了一种忆容器的实现电路,包括第一运算放大器、第二运算放大器、第一电容、第二电容、第三电容、电阻、反馈电阻、电流反馈运算放大器以及第一乘法器;忆容器的实现电路由上述部件相互连接而成,测量电路所得的q-v曲线符合磁控式忆容器表现出的明显的记忆效应,其状态变量关系曲线具有滞回性,因此,该实现电路相当于一个磁控式忆容器,且电路结构简单,参数调节方便。
申请公布号 CN204331729U 申请公布日期 2015.05.13
申请号 CN201420772906.0 申请日期 2014.12.09
申请人 广西大学 发明人 陆益民;金麒麟;黄险峰
分类号 G06F17/50(2006.01)I 主分类号 G06F17/50(2006.01)I
代理机构 北京中誉威圣知识产权代理有限公司 11279 代理人 王正茂
主权项 一种忆容器的实现电路,其特征在于,包括:第一运算放大器、第二运算放大器、第一电容、第二电容、第三电容、电阻、反馈电阻、电流反馈运算放大器以及第一乘法器;所述第一运算放大器的正相输入端与所述第一乘法器的第一输入端以及所述电流反馈运算放大器的TZ端相连,所述第二运算放大器的输出端与所述第一乘法器的第二输入端相连,所述第一电容的一端与所述第二运算放大器的输出端相连;所述第二运算放大器的反相输入端与所述第一电容的另一端以及所述电阻的一端相连,所述反馈电阻与所述第一电容并联,所述第一运算放大器的输出端与所述电阻的另一端以及所述第一运算放大器的反相输入端相连,所述电流反馈运算放大器的反相输入端与所述第二电容的一端相连,所述第二电容的另一端与所述第一乘法器的输出端相连,所述第三电容的一端与所述第一乘法器的输出端相连。
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