发明名称 |
全数字域的广播电视激励器 |
摘要 |
本实用新型涉及全数字域的广播电视激励器,涉及广播发射技术领域。本实用新型包括依次连接的现场可编程门阵列FPGA、高速数字模拟转换器DAC和滤波放大器。其结构特点是,所述现场可编程门阵列FPGA中包括依次连接的输入码流处理单元、基带编码单元、预校正单元和上变频单元,软核单元对上述各单元分别进行控制。供电模块对各器件供电,存储模块和接口模块分别与现场可编程门阵列FPGA相互连接,时钟模块输出到高速数字模拟转换器DAC。本实用新型具有电路结构简单、集成度高、分离器件少、整体电路体积小、生产调试简单的特点,克服了固有杂散,全数字域正交上变频确保了输出射频信号质量高。 |
申请公布号 |
CN203590325U |
申请公布日期 |
2014.05.07 |
申请号 |
CN201320643543.6 |
申请日期 |
2013.10.18 |
申请人 |
北京同方吉兆科技有限公司 |
发明人 |
唐柳 |
分类号 |
H04N5/38(2006.01)I |
主分类号 |
H04N5/38(2006.01)I |
代理机构 |
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代理人 |
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主权项 |
全数字域的广播电视激励器,它包括依次连接的现场可编程门阵列FPGA(1)、高速数字模拟转换器DAC(2)和滤波放大器(3),其特征在于,所述现场可编程门阵列FPGA(1)中包括依次连接的输入码流处理单元(1.1)、基带编码单元(1.2)、预校正单元(1.3)和上变频单元(1.4),软核单元(1.5)对上述各单元分别进行控制;供电模块(4)对各器件供电,存储模块(5)和接口模块(6)分别与现场可编程门阵列FPGA(1)相互连接,时钟模块(7)输出到高速数字模拟转换器DAC(2)。 |
地址 |
100083 北京市海淀区清华同方科技广场A座29层 |