发明名称 开关装置及具有该开关装置的多通道耦合选择器
摘要 本发明公开了一种开关装置,应用于CMOS器件中,包括:第一级开关;与所述第一级开关连接的第二级开关,所述第二级开关包括传输管和与所述传输管连接的双开关结构,所述双开关结构用于控制所述传输管导通或者截止;与所述第二级开关连接的第三级开关;以及,分别与所述第一级开关、所述第二级开关和所述第三级开关连接的CLK/CLKB时钟。本发明还公开了一种多通道耦合选择器,包括N个信号选择通道,所述信号选择通道包括:一与门;与所述与门的输出端连接的反相器和如权利要求1-11所述的开关装置。本发明可以以较小的代价,实现较好的信号传输控制;同时可以有效抗多通道耦合选择器的级间信号串扰和噪声信号的干扰。
申请公布号 CN103647539A 申请公布日期 2014.03.19
申请号 CN201310554295.2 申请日期 2013.11.08
申请人 上海华力微电子有限公司 发明人 陈璐;张宁
分类号 H03K17/693(2006.01)I 主分类号 H03K17/693(2006.01)I
代理机构 上海申新律师事务所 31272 代理人 竺路玲
主权项 一种开关装置,应用于CMOS器件中,其特征在于,包括:第一级开关,所述第一级开关的输入端接入一输入信号;与所述第一级开关连接的第二级开关,所述第二级开关包括传输管和与所述传输管连接的双开关结构,所述双开关结构用于控制所述传输管导通或者截止,所述输入信号由导通的传输管传输或者由截止的传输管隔离;与所述第二级开关连接的第三级开关,所述第三级开关将接收到的由导通的传输管传输的所述输入信号输出;以及,分别与所述第一级开关、所述第二级开关和所述第三级开关连接的CLK/CLKB时钟,所述CLK/CLKB时钟用于传输CLK时钟信号和CLKB时钟信号。
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