发明名称 CONVERSOR DE RELOJ DE 2.048 MHz A SENAL DE LINEA A 2.048Mbit/s
摘要 El conversor de reloj de 2.048 MHz a senal de línea de 2.048 Mbit/s, es un equipo disenado para generar una trama de senal PCM a 2.048 Mbit/s a partir deun reloj de 2.048 MHz de entrada. La senal de trama PCM con Codigo de Redundancia Cíclica (CRC) que crea este equipo, aunque no lleva tráfico de datos sí quelleva incluida la informacion de fase del reloj de entrada. Dispone de ocho salidas de datos sincronizadas en fase con el reloj de entrada de 2.048 MHz. Tantola interfaz de entrada como lasocho tramas de salida PCM se ajustan a las recomendaciones G.703, G.704 y G.706 de la UIT-T. Además dispone de una senal dealarma que se activa en el caso que desaparezca la senal de reloj de 2.048 MHz de la entrada del conversor.
申请公布号 AR022141(A1) 申请公布日期 2002.09.04
申请号 AR1999P106812 申请日期 1999.12.29
申请人 TELEFONICA S.A. 发明人
分类号 H04J3/06;(IPC1-7):H04J3/06 主分类号 H04J3/06
代理机构 代理人
主权项
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