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<p>본 발명은 컴퓨터 사이언스에 관련된 것이며 신경 네트웍 에뮬레이션과 실시간 디지털 신호 처리에 사용될 수 있다. 신경 프로세서 성능을 증가시키는 것은 프로그램 모드에서 결과들의 워드 길이를 변화할 수 있는 능력에 의해 얻어진다. 신 경 프로세서는 프로그램 가능한 워드 길이 데이터의 벡터들에 대한 연산들을 수행하기 위한 여섯 개의 레지스터들, 하나의 시프트 레지스터, 하나의 AND 게이트, 두 개의 FIFO들, 하나의 스위치, 하나의 멀티플렉서, 두 개의 포화 유니트들, 하나의 계산 유니트 및 하나의 가산 회로를 포함한다. 포화 유니트의 성능을 증가시키는 것은 프로그램 가능한 워드 길이를 가지고 입력 오퍼랜드들을 동시에 처리하는 능력에 의해 얻어진다. 상기 유니트는 올림수 예견 회로 하나 및 올림수 전달 회로 하나를 포함하며 또한 각 비트에는 두 개의 멀티플렉서들, 하나의 EXCLUSIVE OR 게이트, 하나의 EQUIVALENCE 게이트, 하나의 NAND 게이트 및 각 비트에 반전된 입력을 가지는 하나의 AND 게이트를 포함한다. 계산 유니트의 기능성은 확대된다. 계산 유니트는 하나의 지연 소자, 반전된 입력을 가지는 N/2개의 AND 게이트들, 곱셈기 비트들의 N/2개의 디코더들, 각 비트는 반전된 입력을 가지는 하나의 AND 게이트, 하나의 멀티플렉서 및 하나의 트리거로 구성된 N비트 시프트 레지스터 한 개 및 그들 각각은 두 개의 트리거들, 반전된 입력을 가지는 하나의 AND 게이트, 일 비트(one-bit) 부분곱 생성 회로 하나, 일 비트 가산기 하나 및 하나의 멀티플렉서로 구성된 N열 곱하기 N/2 셀들을 포함한다. 가산기 회로의 성능을 증가시키는 것은 프로그램 가능한워드 길이들의 입력 오퍼랜드들의 두 벡터들을 더하는 능력에 의해 얻어진다. 가산기 회로는 올림수 예견 회로를 포함하며, 각 비트에는 반전된 입력을 가지는 두 개의 AND 게이트들, 하나의 반가산기 및 하나의 EXCLUSIVE OR 게이트를 포함한다.</p> |
