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L'invention concerne un procédé d'optimisation de l'écriture par un bloc maître dans un dispositif d'interfaçage entre ledit bloc maître et un bloc esclave, ledit bloc maître exécutant un code en langage machine obtenu à partir d'un code en langage assembleur comprenant une suite d'écritures unitaires permettant d'écrire des groupes de mots qui sont des instructions destinées à être lues et exécutées par ledit bloc esclave et comprenant chacune un mot de code opération et k mots d'opérande, avec k>=0, ledit bloc maître comprenant un bus d'écriture dont la taille est égale à N*T, avec T la taille d'un mot et N un entier supérieur ou égal à deux. Le procédé comprend une étape de transformation dudit code en langage assembleur, effectuée préalablement à l'obtention dudit code en langage machine et comprenant les étapes suivantes : transformation (71) de toutes les écritures unitaires statiques de plus d'un mot dudit code en langage assembleur en écritures unitaires statiques d'un mot ; recherche (72) de chaque ensemble de N écritures unitaires statiques successives d'un mot ; remplacement (74) dans ledit code en langage assembleur d'au moins un ensemble de N écritures unitaires statiques successives d'un mot par une écriture unitaire statique de N mots.
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