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Eine integrierte Speicherschaltung und ein entsprechendes Verfahren zum Segmentieren von Bitleitungen werden bereitgestellt, wo die integrierte Speicherschaltung einen Erfassungsverstärker, eine Schichtbitleitung in Signalkommunikation mit dem Erfassungsverstärker, mehrere Segmentdurchlaßtransistoren in Signalkommunikation mit der Schichtbitleitung, mehrere segmentierte Bitleitungen jeweils in Signalkommunikation mit einem entsprechenden der mehreren Segmentdurchlaßtransistoren, mehrere Speicherzellendurchlaßtransistoren in Signalkommunikation mit einer der mehreren segmentierten Bitleitungen und eine Mehrzahl von Speicherzellenkondensatoren umfaßt, jeder jeweils in Signalkommunikation mit einem entsprechenden der Mehrzahl von Speicherzellentransistoren; und wo das entsprechende Verfahren zum Segmentieren von Bitleitungen das Empfangen einer Speicherzellenadresse, das Aktivieren eines Speicherzellendurchlaßtransistors mit einer Wortleitung, die der Speicherzellenadresse entspricht, das Empfangen eines Signals, das den Speicherzellenladungspegel an einer segmentierten Bitleitung durch den Speicherzellentransistor anzeigt, das Aktivieren eines Segmentdurchlaßtransistors, der der Speicherzellenadresse entspricht, das Empfangen eines Signals, das den Speicherzellenladungspegel an einer Schichtbitleitung durch den Segmentdurchlaßtransistor anzeigt und das Empfangen eines Signals, das den Speicherzellenladungspegel an dem Erfassungsverstärker durch die Schichtbitleitung ...
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