发明名称 Slave-Vorrichtung für ein serielles, synchrones Vollduplexbussystem
摘要 Slave-Vorrichtung für ein serielles, synchrones Vollduplexbussystem, mit: einer Dateneingabestufe zum Empfangen eines Mittelspannungsdatenbussignals von einer Master-Vorrichtung und zum Bereitstellen eines Mittelspannungsdatensignals an einen Datensignalpegelabwärtsschieber, der ein entsprechendes Niederspannungsdatensignal erzeugt; eine Takteingabestufe zum Empfangen eines Mittelspannungstaktbussignals von der Master-Vorrichtung und zum Bereitstellen eines Mittelspannungstaktsignals an einem Taktsignalpegelabwärtsschieber, der ein entsprechendes Niederspannungstaktsignal erzeugt; eine Schnittstellenlogik, die das Niederspannungstaktsignal und das Niederspannungsdatensignal empfängt und eine oder mehrere logische Operationen ausführt, um basierend darauf ein oder mehrere Niederspannungsausgabedatensignale zu erzeugen; ein Synchronisationsverzögerungsflipflop mit einem Verzögerungsflipflopdateneingang, einem Verzögerungsflipfloptakteingang und einem Verzögerungsflipfloptaktausgang, worin ein asynchrones Mittelspannungsausgabedatensignal dem Verzögerungsdatenflipflopeingang zugeführt wird, worin ein Mittelspannungsausgabetaktsignal dem Verzögerungsflipfloptakteingang zugeführt wird und worin der Verzögerungsflipflopdatenausgang ein synchrones Mittelspannungsausgabedatensignal bereitstellt; und eine Datenausgabestufe, die ein Mittelspannungsdatenbussignal an die Master-Vorrichtung sendet, worin das synchrone Mittelspannungsausgabesignal der Datenausgabestufe zugeführt wird.
申请公布号 DE102014218028(A1) 申请公布日期 2016.03.10
申请号 DE201410218028 申请日期 2014.09.09
申请人 INFINEON TECHNOLOGIES AG 发明人 MISSONI, ALBERT;PICHLER, MATTHIAS
分类号 G06F13/40;G06F1/04;G06F13/42 主分类号 G06F13/40
代理机构 代理人
主权项
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