发明名称 |
消除比较器延迟的振荡电路 |
摘要 |
本发明公开了一种消除比较器延迟的振荡电路,包括恒流电流源、每组由至少三个开关组成的三组开关、至少三个等值的接地电容、比较器、减法器以及逻辑模块。这些电容的上极板分别对应连接三组开关的一端;比较器的正输入端连接第一组开关的另一端和恒流电流源间的节点并接收该节点的电压V<sub>P</sub>、负输入端接收参考电压V<sub>REF</sub>;减法器的输出端连接第二组开关的另一端、第一输入端连接第三组开关的另一端、第二输入端接收参考电压V<sub>REF</sub>。每组开关的至少三个开关分别由至少三个控制信号控制其通断,各控制信号轮流置为高电平且同一时间仅一个为高电平。逻辑模块根据比较器的输出产生各控制信号,使得各电容从电压V<sub>P</sub>-V<sub>REF</sub>开始被充电以抵消比较器的延迟。 |
申请公布号 |
CN105305961A |
申请公布日期 |
2016.02.03 |
申请号 |
CN201510724253.8 |
申请日期 |
2015.10.29 |
申请人 |
上海华力微电子有限公司 |
发明人 |
张轩;张宁;陈璐 |
分类号 |
H03B5/04(2006.01)I |
主分类号 |
H03B5/04(2006.01)I |
代理机构 |
上海天辰知识产权代理事务所(特殊普通合伙) 31275 |
代理人 |
吴世华;陈慧弘 |
主权项 |
一种消除比较器延迟的振荡电路,其特征在于,包括一个恒流电流源、每组由N个开关组成的三组开关、N个电容值相等的电容C<sub>1</sub>‑C<sub>N</sub>、比较器、减法器以及一个逻辑模块;所述N个电容C<sub>1</sub>‑C<sub>N</sub>的上极板分别对应连接第一组开关S<sub>11</sub>‑S<sub>1N</sub>的一端、第二组开关S<sub>21</sub>‑S<sub>2N</sub>的一端以及第三组开关S<sub>31</sub>‑S<sub>3N</sub>的一端,下极板接地;所述比较器的正输入端连接所述第一组开关S<sub>11</sub>‑S<sub>1N</sub>的另一端和所述恒流电流源之间的节点并接收该节点处的电压V<sub>P</sub>、负输入端接收参考电压V<sub>REF</sub>;所述减法器的输出端连接所述第二组开关S<sub>21</sub>‑S<sub>2N</sub>的另一端、第一输入端连接所述第三组开关S<sub>31</sub>‑S<sub>3N</sub>的另一端、第二输入端接收所述参考电压V<sub>REF</sub>;所述第一组开关S<sub>11</sub>‑S<sub>1N</sub>分别由控制信号Q<sub>1</sub>‑Q<sub>N</sub>控制其通断,所述第二组开关S<sub>21</sub>‑S<sub>2N</sub>分别由控制信号Q<sub>N</sub>、Q<sub>1</sub>‑Q<sub>N‑1</sub>控制其通断,所述第三组开关S<sub>31</sub>‑S<sub>3N</sub>分别由控制信号Q<sub>N‑1</sub>、Q<sub>N</sub>、Q<sub>1</sub>‑Q<sub>N‑2</sub>控制其通断,其中所述控制信号Q<sub>1</sub>‑Q<sub>N</sub>轮流置为高电平且同一时间仅有一个为高电平;所述逻辑模块的输入端连接所述比较器的输出端,其根据所述比较器的输出信号产生所述控制信号Q<sub>1</sub>‑Q<sub>N</sub>;当控制信号Q<sub>i</sub>为高电平时,所述恒流电流源向所述电容C<sub>i</sub>充电使其上极板电压V<sub>P</sub>升高,当所述电容C<sub>i</sub>的上极板电压V<sub>P</sub>升高至大于所述参考电压V<sub>REF</sub>使所述比较器的输出翻转时,所述逻辑模块将控制信号Q<sub>i+1</sub>或Q<sub>i+1‑N</sub>置为高电平,其余控制信号置为低电平,以使所述减法器的第一输入端接收所述电压V<sub>P</sub>,并将电压V<sub>P</sub>‑V<sub>REF</sub>输出至所述电容C<sub>i+2</sub>或C<sub>i+2‑N</sub>的上极板;N为大于等于3的正整数;i为小于等于N的正整数。 |
地址 |
201210 上海市浦东新区张江高科技园区高斯路568号 |