发明名称 |
一种FPGA芯片的错误检测方法和电路 |
摘要 |
本发明涉及一种FPGA芯片,包括:互连结构(xbar)和位于互连结构中的第一级错误检测单元,互连结构包括多个多路复用器,第一级错误检测单元包括逻辑电路,其中,所述互连结构的多个多路复用器接收输入的数字激励信号并输出第一数字信号,所述第一级错误检测单元基于逻辑电路对输入的第一数字信号进行逻辑运算并输出第二数字信号作为检测信号,由此判断互连结构中是否存在错误。该FPGA芯片在进行错误检测时无需考虑互连单元之间的互连关系和互连特点来设计不用的用例,并确保每个互连单元的所有路径都可被测试。 |
申请公布号 |
CN104237771A |
申请公布日期 |
2014.12.24 |
申请号 |
CN201310247427.7 |
申请日期 |
2013.06.20 |
申请人 |
京微雅格(北京)科技有限公司 |
发明人 |
崔运东;张扬扬;刘明 |
分类号 |
G01R31/3185(2006.01)I |
主分类号 |
G01R31/3185(2006.01)I |
代理机构 |
北京亿腾知识产权代理事务所 11309 |
代理人 |
陈霁 |
主权项 |
一种FPGA芯片,包括:互连结构(xbar)和位于互连结构中的第一级错误检测单元,互连结构包括多个多路复用器,第一级错误检测单元包括逻辑电路,其中,所述互连结构的多个多路复用器接收输入的数字激励信号并输出第一数字信号,所述第一级错误检测单元基于逻辑电路对输入的第一数字信号进行逻辑运算并输出第二数字信号作为检测信号,由此判断互连结构中是否存在错误。 |
地址 |
100083 北京市海淀区学院路30号天工大厦B座20层 |