发明名称 一种缩短锁相环捕获时间的方法
摘要 本发明公开了一种缩短锁相环捕获时间的方法,具体执行如下步骤,步骤一:在进入捕获状态时,设置表示初次进入捕获状态的有效标志;步骤二:进行初次传统捕获过程,并判断本振跟参考源之间的频差;步骤三:当本振跟参考源之间的频差小于一定的阈值时,重新设置参考相位,清除相对相位,并将有效标志清除;步骤四:进行再次传统的捕获过程。采用本发明所述的方法,对捕获的过程进行了优化,在不改变环路参数的情况下,缩短了捕获时间,减小了整个系统的准备时间。尤其是当本振与参考源之间的初始频差比较大,而且不允许在开始捕获时一步到位调整频率时,改善的效果特别明显。
申请公布号 CN100571117C 申请公布日期 2009.12.16
申请号 CN200510117180.2 申请日期 2005.11.03
申请人 中兴通讯股份有限公司 发明人 李学焕;邱文才;赵亚锋
分类号 H04L7/033(2006.01)I 主分类号 H04L7/033(2006.01)I
代理机构 信息产业部电子专利中心 代理人 吴永亮
主权项 1、一种缩短锁相环捕获时间的方法,其特征在于,执行如下处理步骤:步骤一:在进入捕获状态时,设置表示初次进入捕获状态的有效标志,将当前相位设置为参考相位,清除相位差的积分;步骤二:根据鉴相器输出的鉴相值和步骤一设置的参考相位之间的相位差以及该相位差的积分,计算出本振频率的调整量,使本振频率跟踪上参考源频率,据此重复执行调整本振频率,直到本振跟参考源之间的频差小于一定的阈值时,重新设置参考相位,使得本振和参考源之间的相对相位为0,并将有效标志清除,相位差的积分则由当前本振频率调整量反算出来;步骤三:进行传统的捕获过程。
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