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发明名称
全周闸架构的选择蚀刻;SELECTIVE ETCHING FOR GATE ALL AROUND ARCHITECTURES
摘要
本案关系于一种蚀刻牺牲材料的方法。该方法包含:在一反应室内供给半导体基板,其中该基板包含通道配置于该基板上及牺牲层,配置在该通道的至少一部份上。该方法更包含供给卤素间(interhalogen)蒸气至该反应室,以该卤素间蒸气蚀刻该牺牲层的至少一部份,并由该牺牲层下曝露该通道的至少一部份。
申请公布号
TW201535492
申请公布日期
2015.09.16
申请号
TW103140654
申请日期
2014.11.24
申请人
英特尔股份有限公司 INTEL CORPORATION
发明人
宋承宏 SUNG, SEUNG HOON;特科特二世 罗伯特 TURKOT, JR., ROBERT;莫希 安拿 MURTHY, ANAND;金世渊 KIM, SEIYON;坎恩 克莱恩 KUHN, KELIN J.
分类号
H01L21/302(2006.01);H01L21/3065(2006.01)
主分类号
H01L21/302(2006.01)
代理机构
代理人
林志刚
主权项
地址
美国 US
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