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发明名称
具有单一及合并命令之记忆体系统
摘要
某些实施例中,一晶片包括用来含纳写入要求之一要求伫列,以及用以将命令加以排程之排程电路,该等命令包括响应于该等写入要求之命令。该晶片亦包括模式选定电路,用以监控该要求伫列,并且用以响应于该要求伫列而为该排程电路选定一第一或一第二模式,其中于该第一模式中,该排程电路将特定命令排程为分离的单一命令,而于该第二模式中,该排程电路对合并命令排程以代表超过一个分离的单一命令。本案亦说明其他实施例。
申请公布号
TW200732916
申请公布日期
2007.09.01
申请号
TW095147149
申请日期
2006.12.15
申请人
英特尔公司
发明人
陈 雪莉;欧斯伯尼
分类号
G06F13/18(2006.01)
主分类号
G06F13/18(2006.01)
代理机构
代理人
恽轶群;陈文郎
主权项
地址
美国
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