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发明名称
用于半导体晶片进行积体电路怖局之记号设计的方法
摘要
本发明系关于一种用于半导体晶片进行积体电路布局(Layout)之套准记号设计(OverlayMarkDesign)的方法,包括了下列步骤:首先在第一层形成一个方向(X或Y)的第一双外部套准记号条(OuterBar),而后在第二层形成另一个方向(Y或X)的第二双外部套准记号条(OuterBar)。最后在第三层形成一套内部套准记号条(InnerBar),藉以达到于半导体中进行多层间套准之目的。
申请公布号
TW200411893
申请公布日期
2004.07.01
申请号
TW091137799
申请日期
2002.12.27
申请人
中芯国际集成电路制造(上海)有限公司 SEMICONDUCTORMANUFACTURING INTERNATIONAL (SHANGHAI) CORP. 中国
发明人
顾以理
分类号
H01L23/544;G03F7/20
主分类号
H01L23/544
代理机构
代理人
徐贵新
主权项
地址
中国
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