发明名称 一种基于FPGA的简易自动取款机实验装置
摘要 本实用新型公开了一种基于FPGA的简易自动取款机实验装置,包括安装箱和FPGA模块且安装箱的一侧设置有安装槽,安装槽内设置有显示器且显示器包括数码管显示模块,安装槽的一侧设置有安装板且安装板的一侧设置有键盘,键盘包括按键模块;FPGA模块包括分频模块、识别模块、信息模块、密码验证模块、业务选择模块和业务处理模块,分频模块电性连接识别模块、信息模块、业务选择模块和业务处理模块;时钟电性连接分频模块,分频模块电性连接密码验证模块且密码验证模块电性连接业务选择模块。本实用新型基于FPGA平台运行,电路结构简单,方便学生进行掌握;硬件可扩展性高;能够锻炼学生实践动手能力。
申请公布号 CN205302490U 申请公布日期 2016.06.08
申请号 CN201620059260.0 申请日期 2016.01.16
申请人 商洛学院 发明人 赵杰;李亚文
分类号 G07F19/00(2006.01)I 主分类号 G07F19/00(2006.01)I
代理机构 代理人
主权项 一种基于FPGA的简易自动取款机实验装置,包括安装箱(1)和FPGA模块(6)且所述安装箱(1)的一侧设置有安装槽(2),其特征在于,所述安装槽(2)内设置有显示器(3)且所述显示器(3)包括数码管显示模块(301),所述安装槽(2)的一侧设置有安装板(4)且所述安装板(4)的一侧设置有键盘(5),所述键盘(5)包括按键模块(501);所述FPGA模块(6)包括分频模块(8)、识别模块(9)、信息模块(10)、密码验证模块(11)、业务选择模块(12)和业务处理模块(13),所述分频模块(8)电性连接所述识别模块(9)、所述信息模块(10)、所述业务选择模块(12)和所述业务处理模块(13)。
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